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深入解析MCU时钟系统：从架构原理到低功耗调试实战

news 2026/6/15 17:36:56

1. 项目概述：为什么MCU时钟系统是嵌入式开发的“心跳”

如果你刚开始接触嵌入式开发，可能会觉得时钟系统就是个配置几个频率参数的事儿，简单得很。但当你真正开始为一个低功耗的物联网节点做优化，或者为一个实时性要求极高的电机控制项目调试时，就会发现，时钟配置的每一个细节，都直接关系到系统的稳定性、功耗和性能上限。它远不止是“让芯片跑起来”那么简单，而是整个系统设计的“心跳”和“节拍器”。

以我手头这个WPR1516系列MCU（基于ARM Cortex-M0+内核）为例，它的时钟系统就是一个典型的、设计精巧的案例。这个芯片常用于无线充电接收端、智能传感器等对功耗极其敏感的场景。它的时钟树结构清晰地划分了从核心到外设的时钟域，并提供了丰富的门控和分频选项。理解这套机制，你就能明白：为什么CPU可以跑在24MHz，而定时器却能工作在48MHz？为什么进入低功耗模式时，有些模块的时钟会自动关闭，而像看门狗（WDOG）或实时时钟（RTC）这类模块却还能继续工作？这些问题的答案，都藏在时钟系统的设计逻辑里。

简单来说，MCU的时钟系统就像一座城市的供水网络。晶振或内部RC振荡器是“水源”（时钟源），锁相环（FLL/PLL）是“加压泵”（倍频），分频器是各个小区的“水阀”（分频），而时钟门控则是每个用户家里的“水龙头开关”（使能/关闭）。工程师的任务，就是根据每个“住户”（CPU核心、内存、外设）的用水需求（性能）和用水时间（工作周期），来合理设计这套管网，既要保证高峰期供水充足（高性能运行），又要在没人用水时尽量关阀，避免浪费（低功耗休眠）。

本文将带你深入WPR1516的时钟系统内部，我们不仅会逐字解读官方手册里的时钟定义表，更会结合我实际调试中的经验，拆解从时钟源选择、核心时钟生成，到总线与外设时钟分配的全过程。我会重点分享时钟门控的实操配置、低功耗模式下的时钟行为，以及那些手册里不会写、但调试中一定会遇到的“坑”和技巧。目标是让你读完以后，不仅能看懂时钟树框图，更能独立地为你的项目配置出既稳定又高效的时钟方案。

2. 时钟系统核心架构与设计思路拆解

在深入寄存器之前，我们必须先建立起对WPR1516时钟系统整体架构的认知。它的设计遵循了现代低功耗MCU的典型分层思想：一个主时钟源驱动多个时钟域，每个域有独立的分频和门控，最终精准地送达每一个需要时钟的模块。

2.1 核心时钟域解析：不只是CPU跑多快

很多人一提到时钟，首先关心的是CPU主频。在WPR1516中，这对应着Core Clock（核心时钟）。但手册里同时列出了Platform Clock（平台时钟）和System Clock（系统时钟），它们频率相同（最高24MHz），都源自ICSOUTCLK经过DIV1分频器。这容易让人困惑：它们有什么区别？为什么不统一叫一个名字？

这里就体现了精细化的设计。虽然频率相同，但它们服务的对象和关断条件不同：

  • Core Clock (HCLK)：专门驱动ARM Cortex-M0+处理器内核。当CPU执行WFI（等待中断）指令进入Wait模式时，这个时钟可以被停止，让核心彻底休眠以省电。
  • Platform Clock：驱动交叉开关（Crossbar Switch）和嵌套向量中断控制器（NVIC）。你可以把它理解为系统的“交通枢纽”和“应急响应中心”的时钟。即使在CPU休眠的Wait模式下，为了保证中断能正常触发和路由，Platform Clock通常仍需保持运行（即手册中提到的free-running FCLK）。它只在更深的Stop模式下才会关闭。
  • System Clock：直接驱动总线主设备（Bus Masters）。在M0+这类简单系统中，主要的总线主设备就是CPU内核本身（通过DCode和System总线）。所以System Clock和Core Clock在物理上可能是同源的，但在逻辑上划分了不同的时钟域，为未来架构扩展（如增加DMA等另一个主设备）留有余地。

实操心得：在调试时，如果遇到CPU停机后外部中断无法唤醒，或者唤醒后系统状态异常，除了检查NVIC配置，也要确认Platform Clock在低功耗模式下是否配置正确。有些低功耗库函数可能会过于激进地关闭所有时钟，导致中断系统“失联”。

2.2 总线与外围时钟：性能与功耗的平衡点

Bus Clock（总线时钟）和Flash Clock（闪存时钟）在WPR1516中由System Clock经过DIV2分频得到。这意味着，当CPU以24MHz全速运行时，总线（AIPS-Lite）和连接其上的大部分外设（如UART、I2C、ADC等）以及Flash存储器，实际工作在12MHz。

这种设计非常巧妙：

  1. 降低功耗：总线及其上的数字逻辑电路动态功耗与频率成正比。将外设时钟频率降低，能直接节省可观功耗，尤其对于低速外设（如UART、I2C）绰绰有余。
  2. 缓解时序压力：较低的Bus Clock为总线访问留出了更宽松的时序裕量，提高了系统在电压、温度波动下的稳定性。
  3. 匹配Flash速度：许多低功耗MCU的内置Flash存储器无法在全核心频率下进行零等待状态的读取。将Flash Clock分频，可以确保可靠的读写操作，避免因Flash访问超时而导致的取指错误或数据错误。

Timer Clock（定时器时钟）则是一个特例，它由ICSOUTCLK经DIV3分频得到，且最高可达48MHz。这为定时器模块（FTM, FSKDT）提供了更高精度的时间基准。例如，生成高精度的PWM波形或进行精确的时间测量时，更高的定时器时钟意味着更细的分辨率。

2.3 时钟源全景图：从内部IRC到外部晶振

WPR1516提供了多个时钟源，适应不同场景：

  • ICSIRCLK (内部RC，~32kHz)：低精度、低功耗的时钟源。主要用于在深度睡眠模式下为RTC、看门狗等需要持续运行的模块提供时钟，是维持“心跳”的基石。
  • OSCCLK (系统振荡器)：可接外部晶振（4-24MHz）或使用外部时钟源（最高48MHz）。这是获得高精度、高稳定性系统时钟的首选。
  • ICSFLLCLK (锁频环FLL输出，40-50MHz)：芯片内部的“频率合成器”。它可以将低频的参考时钟（如内部的32kHz IRC或外部的低频晶振）倍频到一个稳定的高频，从而无需外部高频晶振即可获得较高的系统性能，节省成本和PCB空间。
  • ICSFFCLK (固定频率时钟)：由系统振荡器或IRC产生，固定频率在31.25–39.0625 kHz范围内。专门作为某些定时器（FTM）的时钟源选项。
  • LPOCLK (低功耗振荡器，20kHz)：来自电源管理控制器（PMC）的超低功耗时钟源。精度一般，但功耗极低，专为超低功耗待机场景下的RTC、看门狗或端口毛刺滤波器设计。

方案选型背后的考量：在项目初期，选择时钟源是一个关键决策。如果你的产品对成本敏感且对时钟精度要求不高（例如一些消费类传感器），那么FEI模式（FLL Engaged Internal，使用内部IRC经FLL倍频）是首选，它无需外部元件。如果产品需要高精度计时或通信（如需要通过UART进行严格时间同步），那么FEE模式（FLL Engaged External，使用外部晶振经FLL倍频）或直接使用PEE模式（如果支持PLL）更为合适。对于始终需要极低功耗后台计时的应用（如每隔一小时唤醒一次采集数据），则必须启用LPOCLK或ICSIRCLK来驱动RTC。

3. 时钟配置的实操要点与深度解析

理解了架构，我们进入实战环节。配置时钟不是简单地往寄存器里写几个魔数，每一步背后都有其道理。

3.1 时钟初始化序列：顺序就是一切

上电或复位后，芯片通常运行在一个默认的、保守的时钟模式下（例如，使用内部低速IRC）。我们需要通过软件将其配置到目标工作模式。这个配置过程必须遵循严格的顺序，否则可能导致芯片锁死或运行不稳定。

一个典型的从默认模式切换到外部晶振模式（FEE）的序列如下：

  1. 使能外部振荡器：首先，配置OSC模块，启动外部晶振，并等待其稳定。手册中OSC_CR[OSCEN]位就是用于此。

    // 假设使用外部晶振，配置OSC模块 OSC->CR |= OSC_CR_OSCEN_MASK; // 使能振荡器 // 等待振荡器稳定，通常需要延时数个毫秒，具体时间参考晶振手册 delay_ms(10);

    注意事项：这里的延时不能简单用循环凑数。对于时序要求严苛的应用，最好通过校准的延时函数或查询OSC模块的状态位（如果提供）来确认振荡器已稳定。

  2. 配置ICS模块，选择时钟源：将ICS的时钟源切换到外部振荡器输出（OSCCLK）。

    // 配置ICS_C1寄存器，选择时钟源等 ICS->C1 = ICS_C1_CLKS(2); // 示例：选择外部参考时钟作为源

  3. 配置FLL并等待锁定：如果使用FLL倍频，需要配置FLL的相关参数（倍频因子），并等待FLL锁定。锁定意味着FLL的输出频率已经稳定在目标值。

    // 配置FLL倍频因子 (例如，将外部8MHz晶振倍频到48MHz) ICS->C4 = (ICS->C4 & ~ICS_C4_DRST_DRS_MASK) | ICS_C4_DRST_DRS(1); // 设置频率范围 ICS->C3 = (ICS->C3 & ~ICS_C3_SCTRIM_MASK) | (some_trim_value); // 可能需要微调 // 等待FLL锁定，通常查询ICS_S寄存器中的LOCK位 while(!(ICS->S & ICS_S_LOCK_MASK));

  4. 配置分频器：最后，根据需要的Core、Bus、Timer时钟频率，配置相应的分频器（DIV1,DIV2,DIV3）。

    // 设置分频器 // DIV1 控制 Core/Platform/System Clock 分频 // DIV2 控制 Bus/Flash Clock 分频 // DIV3 控制 Timer Clock 分频 SIM->CLKDIV = SIM_CLKDIV_OUTDIV1(0) | // DIV1 = 1分频 (24MHz) SIM_CLKDIV_OUTDIV2(1); // DIV2 = 2分频 (Bus Clock = 12MHz) // Timer Clock分频可能在ICS或SIM的另一个寄存器中

为什么顺序重要？如果先切换了核心时钟源到一个尚未稳定的时钟（如未起振的晶振），CPU可能会立即“失速”，导致后续配置代码无法执行。正确的顺序是：先准备新的“水源”（使能振荡器），再接上“水泵”并等它稳定（FLL锁定），最后才切换家里的“总阀门”（切换系统时钟源）。

3.2 时钟门控（Clock Gating）：精细化的功耗管理利器

时钟门控是低功耗设计的核心手段。WPR1516中，每个模块的时钟都可以通过SIM_SCGCx系列寄存器（System Clock Gating Control）独立开启或关闭。

其原理很简单：当模块不需要工作时，关闭它的时钟信号，该模块内部的触发器停止翻转，动态功耗理论上降为零（仅剩微小的静态漏电功耗）。

配置示例：启用UART0和I2C0模块的时钟

// 使能PORTB时钟（因为UART0/I2C0引脚可能复用在此端口） SIM->SCGC5 |= SIM_SCGC5_PORTB_MASK; // 使能UART0模块时钟 SIM->SCGC4 |= SIM_SCGC4_UART0_MASK; // 使能I2C0模块时钟 SIM->SCGC4 |= SIM_SCGC4_I2C0_MASK;

关键注意事项与常见坑点：

  1. 先开时钟，再配置外设：这是铁律。在访问任何外设的寄存器之前，必须确保该外设的时钟已经开启。否则，总线访问会产生错误（可能触发硬故障）。
  2. 关闭时钟前的清理工作：在打算关闭一个模块的时钟以省电前，必须确保该模块已完全停止工作。例如，对于UART，需要等待发送完成；对于ADC，需要停止转换。否则，模块可能处于不确定状态，重新开启时钟时无法正常工作。
  3. 特殊模块的特别警告：手册中特别强调：“Do not disable the SIM_SCGC[ADC] when ADC is running”。这意味着ADC转换过程中绝对不允许关闭其时钟，否则可能导致系统挂起（stalling）。正确的做法是：先停止ADC转换（触发），等待转换完成，然后再关闭时钟。
  4. 理解“时钟”与“功能”的关系：开启时钟只是让模块“通电”，具备了工作的基础条件。模块的具体功能（如GPIO输入输出、UART收发）还需要通过模块自身的配置寄存器来设置。两者是层级关系。

3.3 低功耗模式下的时钟行为

WPR1516支持Run、Wait、Stop三种主要功耗模式。时钟系统的行为在不同模式下差异巨大：

  • Run模式：所有时钟按需运行，全功能状态。
  • Wait模式：CPU核心时钟（Core Clock）停止，但平台时钟（Platform Clock）、系统时钟（System Clock）和总线时钟（Bus Clock）通常保持运行。这意味着中断控制器、总线矩阵以及已使能时钟的外设（如定时器、通信接口）仍在工作，可以产生中断将CPU唤醒。
  • Stop模式：这是最深的睡眠模式。核心时钟、平台时钟、系统时钟、总线时钟以及大部分外设时钟都会停止。只有少数特定的低功耗时钟源（如LPOCLK,ICSIRCLK）以及依赖它们运行的模块（如RTC、看门狗、AWIC异步唤醒中断控制器）可以保持活动，用于实现定时唤醒或外部信号唤醒。

表格：关键时钟在低功耗模式下的状态

时钟名称Run模式Wait模式Stop模式备注
Core Clock开启禁用禁用CPU休眠
Platform Clock开启开启禁用保持中断响应能力
System Clock开启开启禁用
Bus Clock开启开启禁用外设访问停止
Timer Clock开启开启禁用FTM定时器停止
ICSIRCLK可开启可开启可配置保持用于RTC/WDOG
LPOCLK可开启可开启可配置保持极低功耗，用于唤醒源

进入低功耗模式的代码考量：

void enter_stop_mode(void) { // 1. 配置唤醒源，例如使能AWIC，配置某个GPIO引脚为中断唤醒 configure_wakeup_source(); // 2. 确保所有需要保持工作的模块（如RTC）已切换到低功耗时钟源（如LPOCLK） RTC->CR |= RTC_CR_OSCE_MASK; // 假设RTC切换为OSCERCLK // 3. 设置电源模式控制器，准备进入Stop模式 PMC->REGSC |= PMC_REGSC_ACKISO_MASK; // 某些芯片需要此操作 // 4. 执行WFI指令 __WFI(); // 执行到此，说明已被唤醒 }

进入Stop模式后，由于主时钟已停，代码执行暂停。唤醒事件（如RTC闹钟、外部引脚中断）发生后，芯片会先恢复时钟系统，然后从WFI指令后的地址继续执行。这里有个大坑：唤醒后的时钟系统状态可能和进入Stop模式前不同（例如，如果之前使用的是FLL，唤醒后可能默认回到了内部IRC时钟）。因此，在唤醒初始化函数中，必须重新配置系统时钟，确保其恢复到所需的工作频率和模式。

4. 模块时钟分配详解与配置实战

手册中的Table 5-5 “Module clocks”是一张宝藏地图，它清晰地指明了每个模块的“生命线”。我们结合实战来解读。

4.1 模块时钟的三重门

每个模块的时钟输入大致分为三类，理解它们对调试至关重要：

  1. Bus Interface Clock（总线接口时钟）：这是模块与CPU通信的“高速公路”的时钟。模块的寄存器读写操作受此时钟控制。如果这个时钟被门控关闭，CPU将无法访问该模块的寄存器，任何访问尝试都会导致总线错误。
  2. Internal Clocks（内部时钟）：模块内部逻辑工作的时钟。例如，UART模块的波特率发生器时钟、ADC的转换时钟、定时器的计数时钟等。这个时钟可能来自总线时钟，也可能来自其他专用时钟源（如ICSFFCLK对于FTM）。
  3. I/O Interface Clocks（I/O接口时钟）：驱动模块与外部引脚交互逻辑的时钟。例如，I2C的SCL线时钟、RTC的时钟输出等。

以FTM（FlexTimer Module）定时器为例：

  • 总线接口时钟：Bus clock。用于CPU配置FTM的寄存器（如设置模式、计数值）。
  • 内部时钟：Timer clock或ICSFFCLK。这是FTM计数器实际递增的时钟源，决定了定时和PWM的精度。你可以通过FTM模块自身的配置选择其一。
  • I/O接口时钟：无特定I/O时钟，其输出引脚由内部时钟和总线时钟共同控制。

配置FTM使用高频Timer Clock的代码片段：

// 首先，确保Timer Clock已配置为所需频率（例如，ICSFLLCLK分频得到48MHz） // 假设已在系统时钟初始化中完成 // 使能FTM0模块时钟 SIM->SCGC6 |= SIM_SCGC6_FTM0_MASK; // 配置FTM0 FTM0->SC = 0; // 先停止计数器 FTM0->MOD = 47999; // 设置模值，期望产生1kHz中断 (48MHz / (47999+1) / 1分频) // 选择时钟源：这里使用Timer Clock (系统固定分频后的时钟) // 注意：FTM的时钟源选择可能在其SC寄存器的CLKS位域，或通过SIM模块的选项寄存器配置。 // 具体需查阅芯片参考手册的FTM章节。以下为示意： FTM0->SC |= FTM_SC_CLKS(1) | FTM_SC_PS(0); // 选择系统时钟，预分频器1分频 // 使能中断等... FTM0->SC |= FTM_SC_TOIE_MASK;

4.2 特殊模块时钟：RTC与看门狗（WDOG）

RTC和看门狗是系统可靠性的守护者，它们的时钟配置尤为关键，因为即使在最深的Stop模式下，它们也可能需要持续运行。

从手册看，RTC和WDOG的时钟源可以是：

  • Bus clock（仅在Run/Wait模式）
  • LPOCLK（20 kHz，低功耗）
  • ICSIRCLK（~32 kHz，内部RC）
  • OSCERCLK（系统振荡器输出）

如何选择？

  • 对精度要求高：选择OSCERCLK（外部晶振），但功耗较高。
  • 对功耗要求极严：选择LPOCLK，功耗最低，但精度较差（可能有±5%偏差，需校准）。
  • 平衡方案：选择ICSIRCLK，精度和功耗介于两者之间。

配置RTC使用LPOCLK的要点：

// 1. 使能PMC模块（如果LPOCLK由PMC提供） SIM->SCGC5 |= SIM_SCGC5_PMC_MASK; // 2. 使能LPOCLK（如果默认未开启） PMC->REGSC |= PMC_REGSC_LPOCLKS_MASK; // 具体位名需查证，此处为示意 // 等待LPOCLK稳定 delay_us(100); // 3. 使能RTC模块时钟 SIM->SCGC6 |= SIM_SCGC6_RTC_MASK; // 4. 配置RTC时钟源为LPOCLK // 通常通过RTC控制寄存器（RTC_CR）的OSCE或CLKS等位选择 RTC->CR &= ~RTC_CR_SC2P_MASK; // 禁用所有负载电容（如果使用外部晶振则需配置） RTC->CR |= RTC_CR_OSCE_MASK; // 使能振荡器（对于LPOCLK，此步骤可能不同） // 更常见的可能是通过SIM_SOPT1等系统选项寄存器为RTC选择时钟源 SIM->SOPT1 |= SIM_SOPT1_OSC32KSEL(2); // 示例：选择LPOCLK作为RTC时钟源 // 5. 初始化RTC计数器、闹钟等...

重要警告：手册脚注明确指出：ICSIRCLK和OSCERCLK“does not support being enabled during entering stop mode.”这意味着，你不能在芯片即将进入Stop模式的瞬间，才去尝试开启这两个时钟源给RTC。正确的做法是：在进入Stop模式之前，就提前配置好RTC的时钟源并确保其稳定运行。否则，RTC在Stop模式下可能无法工作。

5. 时钟系统常见问题与调试技巧实录

即使理解了所有原理，实际调试中时钟问题依然是最令人头疼的之一。下面是我总结的几个典型场景和排查思路。

5.1 问题一：系统启动失败，或运行极不稳定

  • 现象：程序下载后无法运行，或运行时偶发死机、数据错误。
  • 排查思路：
    1. 检查时钟源：是否使用了外部晶振？如果是，检查硬件连接（晶振、负载电容）、PCB布局（远离噪声源）。用示波器测量EXTAL引脚，确认晶振是否起振，波形幅度和频率是否正常。
    2. 检查FLL/PLL锁定：如果使用了FLL/PLL，确认在切换时钟源后，是否等待了足够的锁定时间？查询ICS_S[LOCK]位确认锁定状态。没有锁定的时钟输出频率是不准确的，会导致定时器不准、通信波特率错误等一系列问题。
    3. 检查Flash等待状态：如果核心时钟配置得较高（如24MHz），但Flash Clock分频过大或Flash本身访问速度跟不上，会导致CPU取指等待，轻则性能下降，重则取指错误崩溃。检查Flash控制器的等待状态配置寄存器（如FMC_PFAPR），根据核心时钟与Flash时钟的比率设置正确的等待周期。
    4. 检查电压：高频运行需要足够的供电电压。如果芯片工作在电压监测（LVD）的临界点，高频下可能因电压跌落导致不稳定。确保电源质量，并合理配置LVD阈值。

5.2 问题二：低功耗模式电流降不下去

  • 现象：进入Stop模式后，实测电流比数据手册标注的典型值高出一个数量级。
  • 排查思路：
    1. 彻底关闭外设时钟：使用SIM_SCGC寄存器扫描。在进入低功耗模式前，遍历所有SIM_SCGCx寄存器，确保除了必要模块（如AWIC、RTC）外，其他所有外设的时钟门控位都已清零。一个常见的遗漏是PORT模块，即使GPIO未使用，其时钟开启也会消耗少量功耗。
    2. 检查引脚配置：未使用的GPIO引脚应配置为禁止状态（Disable）或设置为输出低/高，避免浮空输入引起内部振荡和漏电。特别是模拟功能引脚，如果配置为数字输入浮空，漏电流可能很大。
    3. 确认时钟源已切换/关闭：进入Stop模式前，高速系统时钟（ICSOUTCLK）应已停止。确认你配置的时钟模式（如STOP模式）是否确实会关闭主时钟。同时，确认为RTC/WDOG提供时钟的低速源（LPOCLK或ICSIRCLK）已正确配置并运行。
    4. 使用调试器的影响：连接JTAG/SWD调试器通常会阻止芯片进入最深的低功耗模式。测量功耗时，应断开调试器，通过GPIO翻转或串口输出来判断芯片是否按预期唤醒。

5.3 问题三：外设（如UART、定时器）工作不正常

  • 现象：UART发送乱码，定时器定时不准。
  • 排查思路：
    1. 时钟源和分频计算：这是最高频的原因。以UART波特率为例，其波特率发生器时钟通常来源于Bus Clock。计算分频值时，务必使用实际的、当前的Bus Clock频率，而不是Core Clock频率。例如，Core Clock=24MHz，DIV2=1，则Bus Clock=12MHz。计算115200波特率的分频值应为12000000 / (115200 * 16) ≈ 6.51，取整为6或7，然后计算实际波特率误差是否在可接受范围（通常<2%）。
    2. 模块时钟是否使能：确认SIM_SCGCx寄存器中对应外设的位已被置1。这是最容易被忽略的一步。
    3. 时钟门控冲突：确保在操作外设寄存器（读或写）时，该外设的时钟没有被动态关闭。例如，在中断服务程序或某个任务中操作外设前，如果之前有关闭时钟的节能策略，需要先临时开启。

5.4 调试技巧：利用寄存器快照和工具

  1. 寄存器初始化检查表：为时钟系统关键寄存器（如ICS_C1,ICS_C2,ICS_C3,ICS_C4,SIM_CLKDIV,SIM_SOPT1/2, 各个SIM_SCGCx）创建一个预期值表格。在系统初始化后，读取这些寄存器的值并与预期对比，可以快速定位配置错误。
  2. 使用时钟输出功能：一些MCU允许将内部时钟（如Core Clock, Bus Clock）映射到特定引脚输出。用示波器测量这个引脚，可以直观地确认时钟频率是否正确。检查WPR1516的SIM_SOPT2寄存器，看是否有类似CLKOUTSEL的功能。
  3. 仿真器查看时钟树：如果使用Keil MDK、IAR EWARM或MCUXpresso IDE等高级调试环境，它们通常提供“时钟配置工具”或“系统视图”，可以图形化地显示当前时钟配置和频率，非常直观。
  4. 编写简单的时钟测试程序：在系统初始化后，让一个GPIO引脚以系统时钟的固定分频（如1/1000000）翻转。用逻辑分析仪测量翻转频率，反推系统时钟频率，这是验证时钟配置是否生效的最直接方法。

时钟系统的调试，三分靠代码，七分靠耐心和细致的测量。每一次成功的配置，都是对芯片理解更深一步的过程。

http://www.rkmt.cn/news/1529981.html

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